Bezahlverfahren
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High-Frequency Phase-Locked Loop in CDIP28 Package
DIP-28Hersteller:
PHILIPS SEMICONDUCTORS
Herstellerteil #:
HEF4750VD
Datenblatt:
Part Life Cycle Code:
Transferred
HTS Code:
8542.39.00.01
JESD-30 Code:
R-XDIP-T28
JESD-609 Code:
e0
EDA/CAD Modelle:
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Part Life Cycle Code | Transferred | Reach Compliance Code | |
HTS Code | 8542.39.00.01 | JESD-30 Code | R-XDIP-T28 |
JESD-609 Code | e0 | Number of Terminals | 28 |
Operating Temperature-Max | 85 °C | Operating Temperature-Min | -40 °C |
Power Supplies | 10 V | Qualification Status | Not Qualified |
Supply Current-Max (Isup) | 0.75 mA | Supply Voltage-Nom (Vsup) | 10 V |
Surface Mount | NO | Technology | CMOS |
Temperature Grade | INDUSTRIAL | Terminal Finish | Tin/Lead (Sn/Pb) |
Terminal Form | THROUGH-HOLE | Terminal Pitch | 2.54 mm |
Terminal Position | DUAL |
After-Sales- und Abwicklungsbezogen
Bezahlverfahren
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AVAQ bestimmt und verpackt alle Geräte auf der Grundlage der Schutzanforderungen gegen elektrostatische Entladung (ESD) und Feuchtigkeitsempfindlichkeit (MSL)..
365-Tage-Produkt
Qualitätsgarantie
Wir versprechen, 365 Tage Qualitätssicherung für alle unsere Produkte zu bieten.
Menge. | Einzelpreis | Ext. Preis |
---|---|---|
1+ | - | - |
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